活動訊息
內容簡介
VHDL使用者指引
本書主要目的是為了幫助硬體設計工程師學習如何寫出好的 VHDL 程式。透過提供充份的 VHDL 和設計方法的資訊，以幫助設計師快速地完成良好的 VHDL 設計，並能夠驗證其結果。
此外，本書同時嘗試幫助原先對 VHDL 一無所知的設計師能夠很快地寫出複雜的 VHDL 敘述。而著重於告訴讀者如何寫出簡潔、有效率且正確的 VHDL 硬體設計描述。
本書由三部份所組成，在第一部份裡，我們首先簡介 VHDL 這個硬體描述語言; 接著在第二部份裡，我們介紹以 VHDL 為核心的硬體設計流程，其中包括了設計模擬、電路合成、電路佈置與繞線，以及 VITAL 模擬。
至於第三部份，我們則以一個小型中央處理器 (CPU) 為設計實例，來展示第二部份所介紹的 VHDL 從設計輸入到最後產生邏輯閘層次設計的設計流程。本書的附錄部份則包括了一些有關 VHDL 語言本身及相關設計實例等對讀者相當有用的資料。
作者簡介
Douglas L. Perry
Exemplar Logic, Inc. 的資深應用工程師，有 15 年以上的電腦輔助電路設計經驗。他是本書前兩版的作者，而且是VHDL 用戶族群的共同主持人。Perry 在南達科它大學獲得電子工程學士學位，並於 Santa Clara 大學做碩士研究。
譯者簡介
林嘉興
國立交通大學電機資訊博士，曾任國科會晶片系統設計中心研究員、中華大學電機系兼任助理教授，專長於超大型積體電路設計、計算機結構、電腦網路。
目錄
VHSIC計劃 1-2
VHDL標準 1-2
學習VHDL 1-3
VHDL專用術語 1-4
傳統的設計方法 1-5
第二章、行為模型
行為模型簡介 2-2
慣性延遲器與傳送延遲器 2-6
模擬差量 2-11
驅動器 2-15
通用參數(Generics) 2-17
區塊敘述 2-20
第三章、循序處理
程序敘述(Process Statement) 3-2
信號配置相對於變數配置 3-5
循序敘述 3-9
IF 敘述 3-9
CASE敘述 3-11
LOOP敘述 3-13
EXIT敘述 3-17
ASSERT敘述 3-19
WAIT敘述 3-22
並行配置問題 3-30
被動程序 3-33
第四章、資料型別
物件型別 4-2
資料型別 4-7
檔案型別注意事項 4-38
配送方式
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