Verilog 硬體描述語言（附範例光碟片）（第二版）（03504017）
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內容簡介
本書涵蓋Verilog HDL的廣泛內容，對邏輯合成部份有深入的探討並輔以實例說明。
本書內容包含運用Verilog、階層模組的觀念、Verilog的基本概念、邏輯閘層次模型、資料處理模組、行為模型、任務與函數、有用的程式技巧及高階Verilog的邏輯設計、本書適合作為大學電子、資工「VHDL設計」、「VHDL晶片設計」等課程所使用。
■ 本書優點特色
1.本書涵蓋Verilog的廣泛內容，包含基礎Verilog語言到高階Verilog語言，都有詳盡的分析與討論。
2.本書對Verilog語言有充份的探討及實例說明，能幫助讀者了解Verilog的程式結構，進而學會完成設計IC的方法。
目錄
Part1 基本Verilog的使用
第1章 導論：運用 Verilog HDL 作邏輯設計
1.1計算機輔助數位設計的發展1-2
1.2硬體描述語言(HDL)出場1-3
1.3標準設計流程 1-4
1.4硬體描述語言的重要性1-6
1-5Verilog HDL的普及1-7
1-6硬體描述語言未來的趨勢1-7
第2章 階層模組的觀念
2.1設計方法2-2
2.24位元漣波進位計數器2-4
2.3模 組 2-5
2.4別 名2-8
2.5模 擬2-10
2.6例 題2-11
2.6.1 設計區塊 2-11
2.6.2 觸發區塊 2-13
2.7總 結2-16
2.8習 題2-16
第3章 使用Verilog 的基本概念
3.1語法協定3-2
3.1.1 空白3-2
3.1.2 註解3-3
3.1.3 運算子3-3
3.1.4 數字規格3-3
3.1.5 字串3-5
3.1.6 定義名稱(Identifers)與關鍵字(Keywords)3-5
3.2資料型態3-5
3.2.1 數值組3-5
3.2.2 接線3-6
3.2.3 暫存器3-7
3.2.4 向量3-8
3.2.5 整數、實數、和時間暫存資料型態3-10
3.2.6 陣列3-11
3.2.7 記憶體3-12
3.2.8 參數3-12
3.2.9 字串3-13
3.3系統任務和編譯指令3-14
3.3.1 系統任務3-14
3.3.2 編譯命令3-18
3.4總 結3-19
3.5習 題3-20
第4章 模組與輸出入埠
4.1模 組4-2
4.2輸出入埠4-6
4.2.1 輸出入埠的列表4-6
4.2.2 埠的宣告4-7
4.2.3 輸出入埠的連接規定4-9
4.2.4 輸出入埠與外部訊號連接的方法4-11
4.3階層化的取名方法4-13
4.4總 結4-15
4.5習 題4-15
第5章 邏輯閘層次模型
5.1閘的種類5-2
5.1.1 And/Or閘5-2
5.1.2 Buf/Not閘5-5
5.1.3 別名陣列5-7
5.1.4 範例5-8
5.2閘的延遲5-15
5.2.1 上昇，下降，和關閉延遲 5-15
5.2.2 Min/Typ/Max數值5-17
5.2.3 延遲的範例5-18
5.3總 結5-21
5.4習 題5-21
第6章 資料處理模型
6.1持續指定的描述6-3
6.1.1 隱含式的持續指定6-4
6.1.2 隱含式的接線宣告6-5
6.2延 遲6-5
6.2.1 正規指定延遲6-6
6.2.2 隱含式連續指定延遲6-7
6.2.3 接線宣告延遲6-7
6.3運算式、運算子與算元6-8
6.3.1 運算式6-8
6.3.2 運算元6-8
6.3.3 運算子6-9
6.4運算子的種類6-9
6.4.1 算術運算子6-11
6.4.2 邏輯運算子6-13
6.4.3 比較運算子6-14
6.4.4 相等運算子6-14
6.4.5 位元運算子6-15
6.4.6 化簡運算子6-17
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